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    同步十进位计数器具有内部进位前瞻性，适用于高速计数设计。同步操作是通过所有触发器同时计时来实现的，这样，当计数使能输入和内部选通发出指令时，输出变化彼此一致。这种模式是消除输出计数尖峰，通常与异步（纹波时钟）计数器。缓冲时钟输入触发时钟输入波形上升（正向）边缘上的四个触发器。该计数器完全可编程；也就是说，输出可以预设为任一电平。由于预置是同步的，在负载输入端设置低电平将禁用计数器，并使输出在下一个时钟脉冲后与设置数据一致，而不管启用输入的电平如何。如果使能输入在转换时或转换之前为高电平，则当时钟为低电平时，应避免该设备负载输入处的低电平到高电平转换。清除功能是异步的，清除输入的低电平设置所有四个触发器输出。进位先行电路为n位同步应用提供级联计数器，而无需额外获取。实现这个功能的工具是两个计数使能输入和一个纹波进位输出。两个计数使能输入（P和T）都必须高才能计数，并且输入T被前馈以启用纹波进位输出。由此启用的纹波进位输出将产生高电平输出脉冲，其持续时间约等于Q-a输出的高电平部分。这种高电平溢出纹波进位脉冲可用于实现连续级联级。仅当时钟输入为高电平时，启用P或T输入的高电平到低电平转换才会发生。